позволяет программно реализовать разрешения или запрет в обслуживании
любого внешнего устройства ввода/вывода без анализа запроса прерывания в
схеме прерывания системы.
В нашем случае необходимо запрограммировать микросхему 580ВВ55 на
вывод информации в режиме 0. Вот почему далее будет рассмотрен только этот
режим.
При работе микросхемы в режиме 0 обеспечивается простой ввод/вывод
информации через любой из 3-х каналов и сигналов управления обменом
информацией с периферийными устройствами не требуется. В этом режиме
микросхема представляет собой совокупность 2-х 8 разрядных и 2-х 4
разрядных каналов ввода или вывода. В режиме 0 возможны 16 различных
комбинаций схем ввода/вывода каналов ВА, ВВ, ВС. Это определяется
комбинациями в разрядах D4; D3; D1; D0 регистра управляющего слова.
Для нашего случая код должен иметь следующее указание:
|D4 |D3 |D1 |D0 |ВА;ВВ;ВС |
|0 |0 |0 |0 |вывод |
В режиме 0 входная информация не запоминается, а выходная хранится в
выходных регистрах до записи новой информации в канал или до записи нового
режима.
Графическое представление режима 0 показано на рисунке 8.
Канал адреса
Канал управления
Канал данных
D7[pic]D0
I/0 I/0 BC7[pic]BC0 BA7[pic]BA0
BB7[pic]BB0
Рисунок 8.
Для электрического соединения микросхемы 580ВВ55 и схемы управления
необходимо:
1) шину данных D0[pic]D7 схемы управления соединить с выводами
D0[pic]D7 микросхемы 580ВВ55.
2) Два младших разряда адресной шины соединить с выводами A0[pic]A1
микросхемы 580ВВ55.
3) Выводы [pic], [pic] микропроцессора 1821ВМ85 соединить с выводами
[pic], [pic] микросхемы 580ВВ55 соответственно.
4) На вход SR «Установка в исходное состояние» микросхемы 580ВВ55
подать низкий уровень (подключить к корпусу).
1.2.11. Фиксирующая схема.
Как уже отмечалось выше необходимо подавать сигналы в блок индикации
№ канала (2 индикатора) в строго определенные моменты времени. Для этого
необходимо предусмотреть устройство, которое по сигналам от процессора,
будет пропускать информацию на один из индикаторов блока индикации. В
качестве элементов фиксирующей схемы будем использовать 2 регистра типа
1533UP23.
Регистр, аналогичный UP22, нос 8 тактируемыми триггерами. Регистр
принимает и отображает информацию синхронно с положительным перепадом на
тактовом входе.
| |EO |C |Dn |Выход |
|Загрузка и считывание |Н | |«Н», «В» |«Н», «В» |
| | | | |соответственно |
|Загрузка регистра и |В | |«Н», «В» | |
|разрыв выходов | | | | |
Таким образом, подавая тактирующие сигналы на вход С (№11) регистра
1533UP23, мы разрешаем прохождение сигналов на соответствующий индикатор в
строго определенные моменты времени.
Un - № 20
Земля - № 10
1.2.12. Согласующая схема.
Для организации вывода информации в остальные блоки тюнера будем
использовать регистр 1533UP23, тактируемый сигналами от микропроцессора.
Принцип включения и управления регистра 1533UP23 рассмотрен в
предыдущей главе.
Для приема информации в устройство управления будем использовать
шинный формирователь 1533АП6. Как известно шинный формирователь
обеспечивает передачу информации в обоих направлениях. Для обеспечения
только ввода данных вывод №1 соединим с корпусом. Если появится
необходимость в выводе большего количества информации из устройства
управления, то с помощью микросхемы 1533АП6 можно будет решить данную
проблему.
Более подробная информация о микросхеме 1533АП6 приведена в главе
«Шина данных микропроцессора 1821ВМ85».
1.2.13. Схема дешифрации.
В предыдущих главах были рассмотрены основные блоки схемы управления
и было отмечено, что МП в строго определенные моменты времени должен
взаимодействовать с определенными микросхемами. Поэтому в данной схеме
будет подключать к его шинам адреса или данных ту или иную микросхему или
группу микросхем. Из этого можно заключить, что в схеме системы должен
протекать некоторый процесс однозначного выбора и он организуется подачей
на линии адреса А11[pic]А15 определенного кода выбора или сигнала
разрешения доступа к отдельному блоку или блокам. К счастью, эта проблема
является классической и она имеет простое решение. В частности можно
использовать дешифратор, выполненный в виде ТТЛ устройства среднего уровня
интеграции, предназначенного для преобразования двоичного кода в напряжение
логического уровня, которое появляется в том выходном проводе, десятичный
номер которого соответствует двоичному коду. В последствии выходной провод
дешифратора подключают к входу «Выбор микросхемы» нужной микросхемы
(например вывод №18 (CS) микросхемы 537РУ10).
В качестве дешифратора будем использовать микросхему 1533ИД7. Выбор
данного дешифратора обусловлен количеством выходных линий и нагрузочной
способностью.
Микросхема 1533ИД7 – высокоскоростной дешифратор, преобразующий
трехразрядный код А0[pic]А2 (№1[pic]3) в напряжение низкого логического
уровня, появляющегося на одном из восьми выходов 0[pic]7. Дешифратор имеет
трехвходовый логический элемент разрешения.
В таблице показано, что дешифрация происходит, когда на входах
[pic](№4) и [pic](№5), напряжение низкого уровня, а на входе Е3(№6)
высокого. При других логических уровнях на входах разрешения, на всех
выходах имеются напряжения высокого уровня.
|[pic] |[pic] |В |Q |[pic] |
|Н |Х |Х |Н |В |
|Х |В |Х |Н |В |
|Х |Х |Н |Н |В |
|В |Н |[pic] | | |
|В |[pic] |В | | |
|[pic] |Н |В | | |
Если согласно этим условиям мультивибратор запущен, выходной импульс
можно продолжить, подав на вход [pic] напряжение низкого уровня (или на
вход В-высокого). С момента этой дополнительной операции до окончания
импульса пройдет время [pic]вых.
Схема включения:
5
9
12
10
16 5B
6 R[pic]
C[pic]
11 7
8
1.3. Расчеты параметров и элементов принципиальной схемы.
1.3.1. Расчет адресной шины и шины данных
микропроцессора 1821ВМ85.
При проектировании адресной шины и шины данных необходимо оценить
величину токовой нагрузки, т.к. они связаны со множеством устройств,
подключенных параллельно. Если для адресной шины и шины данных характерен
ток, по величине превосходящий допустимое значение на выходе МП, то такую
линию необходимо буферировать.
a) Расчет адресной шины:
Для микропроцессора максимально допустимая нагрузка на адресной линии
составляет:
Uвых L=0,45 В Iвых L=2 мА
Uвых H=2,4 В Iвых H=400 мкА
для регистра 1533 UP22:
Iвх Н=20 мкА Iвх H[pic]=8[pic]20=160 мкА[pic]400 мкА
Iвх L=0,1 мА IвхL[pic]=8[pic]0,1=0,8 мА[pic]2 мА
Таким образом входной ток микросхемы 1533ИР22 не является большим для
МП 1821ВМ85.
Теперь проверим, обеспечивается ли нагрузочная способность для
элементов схемы, которые являются адресной информации.
А11[pic]А15
+5В А0[pic]А15
А0[pic]А7
А8[pic]А10 А8[pic]А12,А15
1533ИР22 А0[pic]А1
Iвх L=Iвх Н=20 мкА – для ОЗУ
Iвх L=Iвх Н=10 мкА – для ПЗУ
Iвх L=Iвх Н=14 мкА – для устройства в/в.
Iвх L[pic]=Iвх Н[pic]=8[pic]20+8[pic]10+2[pic]14=268 мкА[pic]2,6 мА
Iвх L=24 мА для 1533ИР22
Iвх Н=2,6 мА
Адресные линии А8[pic]А15 буферировать не надо, т.к.
Iвх Н[pic] =3[pic]20+6[pic]10+5[pic]20=220 мкА[pic]400 мкА
Iвх L[pic]=3[pic]20+6[pic]10+5[pic]0,1 мА=620 мкА[pic]2 мА
b) Расчет шины данных.
Для микропроцессора максимально допустимая нагрузка на шине данных
IвыхL=2 мА Uвых L=0,45 В
Iвых H=400 мкА UвыхH=2,4 В
для DНШУ 1533 АП6:
Iвх L=0,1 мА Iвх L[pic]=8[pic]0,1=0,8 мА
Iвх Н=20 мкА Iвх Н[pic]=8[pic]20=160 мкА
Выходной ток МП является большим, чем входной ток микросхемы 1533АП6,
а значит обеспечивается нагрузочная способность по току
Проверим, обеспечивается ли микросхемой 1533АП6 нагрузочная информация
для элементов схемы, которые являются «потребителями» информации о данных.
Страницы: 1, 2, 3, 4, 5, 6, 7, 8, 9, 10, 11, 12